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自動化DDR一致性測試方案商

來源: 發布時間:2025年01月16日

測試軟件運行后,示波器會自動設置時基、垂直增益、觸發等參數進行測量并匯總成一 個測試報告,測試報告中列出了測試的項目、是否通過、spec的要求、實測值、margin等。 自動測試軟件進行DDR4眼圖睜開度測量的一個例子。信號質量的測試還可以  輔 助 用 戶 進 行 內 存 參 數 的 配 置 , 比 如 高 速 的 D D R 芯 片 都 提 供 有 O D T ( O n D i e Termination)的功能,用戶可以通過軟件配置改變內存芯片中的匹配電阻,并分析對信號質 量的影響。

除了一致性測試以外,DDR測試軟件還可以支持調試功能。比如在某個關鍵參數測試 失敗后,可以針對這個參數進行Debug。此時,測試軟件會捕獲、存儲一段時間的波形并進 行參數統計,根據統計結果可以查找到參數違規時對應的波形位置, DDR2 和 LPDDR2 一致性測試軟件。自動化DDR一致性測試方案商

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DDR地址、命令總線的一致性測試

DDR的地址、命令總線的信號完整性測試主要測試其波形和時序參數。地址總線An、 命令總線/RAS、/CAS、/WE、/CS需要測試的信號品質主要包括:Vmax (最大電壓值);Vmin (小電壓值);Overshoot (過沖)和Undershoot (下沖)的持續時間的大值;Slew Rate (斜率);Ringback (回溝)等。還需要測試相對于時鐘邊沿的Setup Time (建立時間)和Hold Time (保持時間)。建立時間和保持時間的定義如圖7.134所示,其中加為建立時間,如為 保持時間,針對DDR400,加和如為0.7ns。


自動化DDR一致性測試方案商82496 DDR信號質量的測試方法、測試裝置與測試設備與流程;

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JEDEC組織發布的主要的DDR相關規范,對發布時間、工作頻率、數據 位寬、工作電壓、參考電壓、內存容量、預取長度、端接、接收機均衡等參數做了從DDR1 到 DDR5的電氣特性詳細對比。可以看出DDR在向著更低電壓、更高性能、更大容量方向演 進,同時也在逐漸采用更先進的工藝和更復雜的技術來實現這些目標。以DDR5為例,相 對于之前的技術做了一系列的技術改進,比如在接收機內部有均衡器補償高頻損耗和碼間 干擾影響、支持CA/CS訓練優化信號時序、支持總線反轉和鏡像引腳優化布線、支持片上 ECC/CRC提高數據訪問可靠性、支持Loopback(環回)便于IC調測等。

如果PCB的設計密度不高,用戶有可能在DDR顆粒的引腳附近找到PCB過孔,這時可以用焊接或點測探頭在過孔上進行信號測量。DDR總線信號質量測試時經常需要至少同時連接CLK、DQS、DQ等信號,且自動測試軟件需要運行一段時間,由于使用點測探頭人手很難長時間同時保持幾路信號連接的可靠性,所以通常會使用焊接探頭測試。有時為了方便,也可以把CLK和DQS焊接上,DQ根據需要用點測探頭進行測試。有些用戶會通過細銅線把信號引出再連接示波器探頭,但是因為DDR的信號速率很高,即使是一段1cm左右的沒有匹配的銅線也會嚴重影響信號的質量,因此不建議使用沒有匹配的銅線引出信號。有些示波器廠商的焊接探頭可以提供稍長一些的經過匹配的焊接線,可以嘗試一下這種焊接探頭。圖5.13所示就是一種用焊接探頭在過孔上進行DDR信號測試的例子。DDR命令、地址和地址總線的建立時間和保持時間定義。

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DDR總線上需要測試的參數高達上百個,而且還需要根據信號斜率進行復雜的查表修 正。為了提高DDR信號質量測試的效率,比較好使用御用的測試軟件進行測試。使用自動 測試軟件的優點是:自動化的設置向導避免連接和設置錯誤;優化的算法可以減少測試時 間;可以測試JEDEC規定的速率,也可以測試用戶自定義的數據速率;自動讀/寫分離技 術簡化了測試操作;能夠多次測量并給出一個統計的結果;能夠根據信號斜率自動計算建 立/保持時間的修正值。尋找能夠滿足您的 DDR 和存儲器需求的特定解決方案。自動化DDR一致性測試方案商

什么是DDR DDR2 DDR3 DDR4 DDR5;自動化DDR一致性測試方案商

DDR 規范的 DC 和 AC 特性

對于任何一種接口規范的設計,首先要搞清楚系統中傳輸的是什么樣的信號,也就是驅動器能發出什么樣的信號,接收器能接受和判別什么樣的信號,用術語講,就是信號的DC和AC特性要求。

在DDR規范文件JEDEC79R的第51頁[TABLE6:ELECTRICALCHARACTERISTICSANDDCOPERATINGCONDITIONS]中對DDR的DC有明確要求:VCC=+2.5V+0.2V,Vref=+1.25V±0.05V,VTT=Vref±0.04V.

在我們的實際設計中,除了要精確設計供電電源模塊之外,還需要對整個電源系統進行PI仿真,而這是高速系統設計中另一個需要考慮的問題,在這里我們先不討論它,暫時認為系統能夠提供穩定的供電電源。

除DC特性外,我們還應該注意規范中提到的AC特性,所謂AC特性,就是信號在高速利轉狀態下所表現出的動態變化特性。DDR規范中第60頁,對外于云態變化的地址信號、控制信號及數據信號分別給出了交流特性的要求。為方便讀者,現把規范中對干信號交流特性的要求復制到這里,作為高速系統設計的一部分,要確保在我們的系統中,所有處于高速工作狀態下的DDR信號要符合這個AC特性規范。 自動化DDR一致性測試方案商

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