DDR系統設計過程，以及將實際的設計需求和DDR規范中的主要性能指標相結合，我們以一個實際的設計分析實例來說明，如何在一個DDR系統設計中，解讀并使用DDR規范中的參數，應用到實際的系統設計中。某項目中，對DDR系統的功能模塊細化框圖。在這個系統中，對DDR的設計需求如下。

整個DDR功能模塊由四個512MB的DDR芯片組成，選用Micron的DDR存諸芯片MT46V64M8BN-75。每個DDR芯片是8位數據寬度，構成32位寬的2GBDDR存諸單元，地址空間為Add<13..0>，分四個Bank，尋址信號為BA<1..0>。 DDR測試信號問題排查；校準DDR一致性測試銷售電話

在進行接收容限測試時，需要用到多通道的誤碼儀產生帶壓力的DQ、DQS等信號。測 試 中 被 測 件 工 作 在 環 回 模 式 ， D Q 引 腳 接 收 的 數 據 經 被 測 件 轉 發 并 通 過 L B D 引 腳 輸 出 到 誤碼儀的誤碼檢測端口。在測試前需要用示波器對誤碼儀輸出的信號進行校準，如DQS與 DQ的時延校準、信號幅度校準、DCD與RJ抖動校準、壓力眼校準、均衡校準等。圖5.21 展示了一整套DDR5接收端容限測試的環境。

DDR4/5的協議測試

除了信號質量測試以外，有些用戶還會關心DDR總線上真實讀/寫的數據是否正確， 以及總線上是否有協議的違規等，這時就需要進行相關的協議測試。DDR的總線寬度很  寬，即使數據線只有16位，加上地址、時鐘、控制信號等也有30多根線，更寬位數的總線甚  至會用到上百根線。為了能夠對這么多根線上的數據進行同時捕獲并進行協議分析，適  合的工具就是邏輯分析儀。DDR協議測試的基本方法是通過相應的探頭把被測信號引到  邏輯分析儀，在邏輯分析儀中運行解碼軟件進行協議驗證和分析。 校準DDR一致性測試銷售電話4代DDR之間有什么區別？

由于讀/寫時序不一樣造成的另一個問題是眼圖的測量。在DDR3及之前的規范中沒 有要求進行眼圖測試，但是很多時候眼圖測試是一種快速、直觀衡量信號質量的方法，所以 許多用戶希望通過眼圖來評估信號質量。而對于DDR4的信號來說，由于時間和幅度的余量更小，必須考慮隨機抖動和隨機噪聲帶來的誤碼率的影響，而不是做簡單的建立/保  持時間的測量。因此在DDR4的測試要求中，就需要像很多高速串行總線一樣對信號疊加  生成眼圖，并根據誤碼率要求進行隨機成分的外推，然后與要求的小信號張開窗口(類似  模板)進行比較。圖5 . 8是DDR4規范中建議的眼圖張開窗口的測量方法(參考資料： JEDEC     STANDARD    DDR4     SDRAM,JESD79-4)。

制定DDR 內存規范的標準化組織是JEDEC(Joint Electron Device Engineering  Council,)。按照JEDEC組織的定義， DDR4 的比較高數據速率已經 達到了3200MT/s以上，DDR5的比較高數據速率則達到了6400MT/s以上。在2016年之 前，LPDDR的速率發展一直比同一代的DDR要慢一點。但是從LPDDR4開始，由于高性 能移動終端的發展，LPDDR4的速率開始趕超DDR4。LPDDR5更是比DDR5搶先一步在 2019年完成標準制定，并于2020年在的移動終端上開始使用。DDR5的規范 (JESD79-5)于2020年發布，并在2021年開始配合Intel等公司的新一代服務器平臺走向商 用。圖5.2展示了DRAM技術速率的發展。DDR總線一致性測試對示波器帶寬的要求；

通常測量眼圖很有效的一種方法就是使用示波器的眼圖測量功能，即用時鐘做觸發對數 據信號進行累積，看累積結果的差情況是否在可以容許的范圍內。但遺憾的是，想用這種 方法直接測量DDR的信號質量非常困難，因為DDR信號讀寫時序是不一樣的。

可以看到，寫數據(DQ)的跳變位置對應著鎖存信號(DQS)的中心，而 讀數據的跳變位置卻對應著鎖存信號的邊沿，而且在總線上還有三態，因此如果直接用DQS 觸發對DQ累積進行眼圖測量的話，會得到的結果。 DDR4 和 LPDDR4 一致性測試應用軟件提供了多種可以簡化設計驗證的關鍵功能。校準DDR一致性測試銷售電話

DDR5 一致性測試應用軟件。校準DDR一致性測試銷售電話

以上只是 一 些進行DDR讀/寫信號分離的常用方法，根據不同的信號情況可以做選 擇。對于DDR信號的 一 致性測試來說，用戶還可以選擇另外的方法，比如根據建立/保持 時間的不同進行分離或者基于CA信號突發時延的方法(CA高接下來對應讀操作，CA低 接下來對應寫操作)等，甚至未來有可能采用一些機器學習(Machine Learning)的方法對 讀/寫信號進行判別。讀時序和寫時序波形分離出來以后，就可以方便地進行波形參數或者 眼圖模板的測量。

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