trombone線的時延是受到其并行走線之間的耦合而影響，一種在不需要提高其間距的情況下，并且能降低耦合的程度的方法是采用sawtooth線。顯然，sawtooth線比trombone線具有更好的效果。但是，依來看它需要更多的空間。由于各種可能造成時延不同的原因，所以，在實際的設計時，要借助于CAD工具進行嚴格的計算，從而控制走線的時延匹配。考慮到在圖2中6層板上的過孔的因素，當一個地過孔靠近信號過孔放置時，則在時延方面的影響是必須要考慮的。先舉個例子，在TOP層的微帶線長度是150mils，BOTTOM層的微帶線也是150mils，線寬都為4mils，且過孔的參數為：barreldiameter=”8mils”，paddiameter=”18mils”，anti-paddiameter=”26mils”。DDR平均速率以及變化情況；通信DDR測試系列

對于DDR2和DDR3，時鐘信號是以差分的形式傳輸的，而在DDR2里，DQS信號是以單端或差分方式通訊取決于其工作的速率，當以高度速率工作時則采用差分的方式。顯然，在同樣的長度下，差分線的切換時延是小于單端線的。根據時序仿真的結果，時鐘信號和DQS也許需要比相應的ADDR/CMD/CNTRL和DATA線長一點。另外，必須確保時鐘線和DQS布在其相關的ADDR/CMD/CNTRL和DQ線的當中。由于DQ和DM在很高的速度下傳輸，所以，需要在每一個字節(jié)里，它們要有嚴格的長度匹配，而且不能有過孔。差分信號對阻抗不連續(xù)的敏感度比較低，所以換層走線是沒多大問題的，在布線時優(yōu)先考慮布時鐘線和DQS。信號完整性測試DDR測試推薦貨源DDR3信號質量自動測試軟件；

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DDR4/5的協議測試除了信號質量測試以外，有些用戶還會關心DDR總線上真實讀/寫的數據是否正確，以及總線上是否有協議的違規(guī)等，這時就需要進行相關的協議測試。DDR的總線寬度很寬，即使數據線只有16位，加上地址、時鐘、控制信號等也有30多根線，更寬位數的總線甚至會用到上百根線。為了能夠對這么多根線上的數據進行同時捕獲并進行協議分析，適合的工具就是邏輯分析儀。DDR協議測試的基本方法是通過相應的探頭把被測信號引到邏輯分析儀，在邏輯分析儀中運行解碼軟件進行協議驗證和分析。

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DDR4/5與LPDDR4/5的信號質量測試由于基于DDR顆粒或DDRDIMM的系統(tǒng)需要適配不同的平臺，應用場景千差萬別，因此需要進行詳盡的信號質量測試才能保證系統(tǒng)的可靠工作。對于DDR4及以下的標準來說，物理層一致性測試主要是發(fā)送的信號質量測試；對于DDR5標準來說，由于接收端出現了均衡器，所以還要包含接收測試。DDR信號質量的測試也是使用高帶寬的示波器。對于DDR的信號，技術規(guī)范并沒有給出DDR信號上升/下降時間的具體參數，因此用戶只有根據使用芯片的實際快上升/下降時間來估算需要的示波器帶寬。通常對于DDR3信號的測試，推薦的示波器和探頭的帶寬在8GHz;DDR4測試建議的測試系統(tǒng)帶寬是12GHz;而DDR5測試則推薦使用16GHz以上帶寬的示波器和探頭系統(tǒng)。 什麼是DDR內存？如何測試？

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DDRSDRAM即我們通常所說的DDR內存，DDR內存的發(fā)展已經經歷了五代，目前DDR4已經成為市場的主流，DDR5也開始進入市場。對于DDR總線來說，我們通常說的速率是指其數據線上信號的快跳變速率。比如3200MT/s,對應的工作時鐘速率是1600MHz。3200MT/s只是指理想情況下每根數據線上比較高傳輸速率，由于在DDR總線上會有讀寫間的狀態(tài)轉換時間、高阻態(tài)時間、總線刷新時間等，因此其實際的總線傳輸速率達不到這個理想值。

克勞德高速數字信號測試實驗室

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什么是DDR？

DDR是雙倍數據速率(DoubleDataRate)。DDR與普通同步動態(tài)隨機內存（DRAM）非常相象。普通同步DRAM（現在被稱為SDR）與標準DRAM有所不同。標準的DRAM接收的地址命令由二個地址字組成。為節(jié)省輸入管腳，采用了復用方式。地址字由行地址選通（RAS）鎖存在DRAM芯片。緊隨RAS命令之后，列地址選通（CAS）鎖存第二地址字。經過RAS和CAS，存儲的數據可以被讀取。同步動態(tài)隨機內存（SDRDRAM)將時鐘與標準DRAM結合，RAS、CAS、數據有效均在時鐘脈沖的上升邊沿被啟動。根據時鐘指示，可以預測數據和其它信號的位置。因而，數據鎖存選通可以精確定位。由于數據有效窗口的可預計性，所以可將內存劃分成4個組進行內部單元的預充電和預獲取。通過突發(fā)模式，可進行連續(xù)地址獲取而不必重復RAS選通。連續(xù)CAS選通可對來自相同行的數據進行讀取。 通信DDR測試系列